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博客园 - 所长

xilinx axi qspi V3.2 slave interrupt lwip 快速 高频 短帧发送 测试 If your port already typedef's in_addr_t, define IN_ADDR_T_DEFINED to prevent this code from redefining it. FPGA Verilog 线性反馈移位寄存器(LFSR) Libero FIFO Controller without Memory Software-Defined Radio for Engineers 一 频谱仪 N9020A 操作步骤记录 FPGA-CAN MAC 层 IP 核测试(二) 源码阅读 libero reg 编译时 占用 RAM 资源 而不是 LUT 资源 加扰和解扰 FPGA-CAN MAC 层 IP 核测试(一) 上板实测 Microchip SoftConsole v2022.2-RISC-V-747 polarfire soc 裸机例程中 链接文件 mpfs-envm-lma-scratchpad-vma.ld 分析 FlashPro5 导致 window11 蓝屏 libero verilog 模块例化时,信号不存在 默认是 不连接 A3P250 在线 debug 抓取信号 Identify 在线逻辑分析仪 MPFS250T MSS 引脚 上下拉配置 如何在 libero 中 写一个 axi4 slave 总线的 IP核 可以 和 CoreAXI4Interconnect 连接 (五) 官方参考 verilog 按键消抖模块 如何在 libero 中 写一个 axi4 slave 总线的 IP核 可以 和 CoreAXI4Interconnect 连接 (四) axi-lite 信号抓取 libero Active Probes 如何在 libero 中 写一个 axi4 slave 总线的 IP核 可以 和 CoreAXI4Interconnect 连接 (三) C代码测试 访问卡死 如何在 libero 中 写一个 axi4 slave 总线的 IP核 可以 和 CoreAXI4Interconnect 连接 (二) axi-lite 如何在 libero 中 写一个 axi4 slave 总线的 IP核 可以 和 CoreAXI4Interconnect 连接(一)libero 设置把模块信号变总线方式 libero 2025.2 Macro Library User Guide for SmartFusion 2 and IGLOO 2 FPGAs 如何在 libero 中 写一个 axi4 slave 总线的 IP核 可以 和 CoreAXI4Interconnect 连接 (零) MSS CFG MPFS250T FLASH 只有 128KB 调整代码优化 AD9361 SPI no-os 文件移植 SoftConsole MPFS250T 初学(七) 初始化日志记录 AD9361 SPI no-os 文件移植 SoftConsole MPFS250T 初学(六) 开启 日志打印 Calibration TIMEOUT (0x247, 0x2) AD9361 SPI no-os 文件移植 SoftConsole MPFS250T 初学(五) ad9361_check_cal_done 卡死
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所长 · 2026-05-04 · via 博客园 - 所长

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上篇文章 : 已经 移植 ad9361 的文件 到 MPFS250t 的 SoftConsole  环境中, 但是 还没有 和  SPI 接口 适配 

官方 初始化 AD9361  例程:

no-OS/projects/ad9361/src/main.c at main · analogdevicesinc/no-OS

  main.c 文件 对 ad96361 进行初始化 ,使用  XILINX_PLATFORM  平台 代码解析:

1、初始化 spi 接口参数 操作接口 

    default_init_param.spi_param.extra = &xil_spi_param;

    default_init_param.spi_param.platform_ops = &xil_spi_ops;

2、设置 复位引脚 编号  和 相关 射频开关矩阵 相关控制引脚

    default_init_param.gpio_resetb.number = GPIO_RESET_PIN;

  • gpio_sync 用于基带同步,是实现多片AD9361内部时钟对齐的关键。

  • gpio_cal_sw1 和 gpio_cal_sw2 则用于控制射频开关矩阵,是实现射频相位校准的硬件基础

  •     default_init_param.gpio_sync.number = -1;

        default_init_param.gpio_cal_sw1.number = -1;

        default_init_param.gpio_cal_sw2.number = -1;

3、如果设备是 AD9364  或者 两发两收 使能,则额外配置

    if (AD9364_DEVICE) {

        default_init_param.dev_sel = ID_AD9364;

        tx_dac_init.num_channels = 2;

        tx_dac_init.rate = 1;

        rx_adc_init.num_channels = 2;

        rx_adc_init.num_slave_channels = 0;

    } else {

        if (!default_init_param.two_rx_two_tx_mode_enable) {

            tx_dac_init.num_channels = 2;

            tx_dac_init.rate = 1;

            rx_adc_init.num_channels = 2;

            rx_adc_init.num_slave_channels = 0;

        }

    }

    if (AD9363A_DEVICE)

        default_init_param.dev_sel = ID_AD9363A;

4、调用 接口 ad9361_init , 初始化 AD9361  

ad9361_init(&ad9361_phy, &default_init_param);

5、 初始化 滤波器

ad9361_set_tx_fir_config(ad9361_phy, tx_fir_config);

ad9361_set_rx_fir_config(ad9361_phy, rx_fir_config);

6、初始化 AXI dmac 接口,暂时不知 这个接口的 作用

// 配置 TX DMA,负责将 内存中的发送数据(例如由 CPU 准备好的正弦波查找表 dac_buffer)高速搬运到 AD9361 的发送 FIFO(最终由 DAC 转换为模拟信号)。

    status = axi_dmac_init(&tx_dmac, &tx_dmac_init);

    if (status < 0) {

        printf("axi_dmac_init tx init error: %"PRIi32"\n", status);

        return status;

    }

// 配置 RX DMA,负责将 AD9361 接收 FIFO 中的 ADC 采样数据高速搬运到 内存中的接收缓冲区(例如 adc_buffer),供 CPU 后续处理。

    status = axi_dmac_init(&rx_dmac, &rx_dmac_init);

    if (status < 0) {

        printf("axi_dmac_init rx init error: %"PRIi32"\n", status);

        return status;

    }

7、 

// 初始化 FPGA 内的 AXI DAC 控制器( axi_ad9361 专用 DAC 接口模块)。

    axi_dac_init(&ad9361_phy->tx_dac, &tx_dac_init);

// 选择 DAC 的数据源,决定发送数据从何处来。

    axi_dac_set_datasel(ad9361_phy->tx_dac, -1, AXI_DAC_DATA_SEL_DDS);